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2017.04.20

RasPiカメラをFPGAにつないで、初めて信号が出た

今日もRasPiカメラをFPGAにつなぐための調査をしています。

Csk_csi

GPIO1と0を立ち上げた後、レジスタ設定を行い、最後に4msほど待ってからスタンバイを解除したら動きました。

レジスタ設定の中で0x6620~6623と、0x45xx番地や0x47xx番地のデータシートに載っていないレジスタについては、設定してもしなくても変化はないようです。

今の設定では1920×1080の30fpsにしたつもりなのですが、クロックは361MHz、

Clk

データレートも361MHzのDDRでした。

Data_1

また、データは団子になってやってきていて、

Data_2

1つの塊の周期は14us。最初はスキマがありますが、後はだいたい詰まっていて、13.48ms送った後、長い休みになります。

Data_4

繰り返しの周波数は32Hzでした。

まとめると、

  • クロック周波数361MHz
  • 1H=14us? ・・・2000~2527pixel ?
  • 1V=962H?

という結果でした。

設定したレジスタの値なども、何を参考にしたかさえよくわからなくなってきているので、次は高速差動信号のデコードに取り組もうと思います。

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コメント

MIPI CSI-2のXilinx社のIPは使えなかったですか?
https://japan.xilinx.com/support/documentation/ip_documentation/mipi_csi2_tx_subsystem/v1_0/pg260-mipi-csi2-tx.pdf

投稿: marsee | 2017.04.25 09:55

教えていただいたPDFは送信側のものでしたが、受信側もあるようですね。

今、Vivadoで使おうとしてみたらライセンスが必要なコアのようで、タダでは使えないようでした。

投稿: なひたふ | 2017.04.27 04:02

失礼いたしました。
私はよくわからないのですが、MIPI D-PHY v3.1ではだめですか?

こちらは、IPIでAdd IPできました。

https://japan.xilinx.com/support/documentation/ip_documentation/mipi_dphy/v3_1/pg202-mipi-dphy.pdf

MIPI D-PHYは物理層だけみたいですね。その後のバックエンドは有料のようですね。

投稿: marsee | 2017.04.27 10:58

確かにIPカタログでMIPIとやると、物理層のが出てきますね。
設定項目でクロックレートを指定しなければならなかったり、出てくるバスの意味がわからなかったり、これを使うにはそれなりに勉強が必要そうですね。
ちなみに、Trenzさんのところでは自分で作っていました。データのデコードはそれほど難しくはない感じです。

投稿: なひたふ | 2017.04.27 13:20

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